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课程目录
1.1 数字逻辑发展史 1.2 Multisim spice仿真介绍和操作 1.3 开关系统 1.4 半导体数字集成电路 1.5.1 基本逻辑门电路分析(1) 1.5.2 基本逻辑门电路分析(2) 1.6 逻辑代数理论和表达式的化简 1.7 毛刺产生和消除 1.8 数字码制表示和转换 2.1.1 组合逻辑电路(1) 2.1.2 组合逻辑电路(2) 2.1.3 组合逻辑电路(3) 2.2 时序逻辑电路 2.3 存储器分类和工作原理 2.4 有限自动状态机 3.1 可编程逻辑器件发展历史 3.2 可编程逻辑器件工艺 3.3 简单可编程逻辑器件内部结构 3.4 CPLD原理及结构 3.5.1 FPGA原理及结构(1) 3.5.2 FPGA原理及结构(2) 4.1 IP核基本概念 4.2 Vivado工具设计流程 4.3 Vivado IP数字系统的设计与实现(一) 4.4 Vivado IP数字系统的设计与实现(二) 5.1 Vivado集成开发环境介绍 5.2 创建新工程和添加Verilog HDL设计文件 5.3 详细描述和行为级仿真 5.4 设计综合和设计约束 5.5 设计实现和时序仿真 5.6 生成比特流和下载设计 6.1 Verilog HDL程序结构 6.2 Verilog HDL描述方式 6.3 Verilog HDL语言要素 6.4 Verilog HDL数据类型(一) 6.5 Verilog HDL数据类型(二) 6.6 Verilog HDL表达式 6.7 Verilog HDL分配 6.8 Verilog HDL门级和开关级描述 6.9 Verilog HDL行为描述语句 6.10 Verilog HDL任务和函数 6.11 Verilog HDL层次化结构 6.12 Verilog HDL系统任务和函数 7.1 组合逻辑电路Verilog HDL描述 7.2 数据运算操作Verilog HDL描述 7.3 时序逻辑电路Verilog HDL描述 7.4 存储器Verilog HDL描述 7.5 有限自动状态机Verilog HDL描述 8.1.1 梦幻呼吸灯的设计和演示(1) 8.1.2 梦幻呼吸灯的设计和演示(2) 8.1.3 梦幻呼吸灯的设计和演示(3) 8.2.1 七段数码管的驱动和演示(1) 8.2.2 七段数码管的驱动和演示(2) 8.3 VGA驱动原理 8.4 VGA上显示彩条的实现 8.5 VGA上显示动态图像的实现 8.6 VGA上显示运动图片的实现 8.7 动态视频的捕获和图像处理的实现 9.1 Vivdo定制IP流程导论 9.2 IP核封装的实现 9.3 IP核调用的实现 10.1 设计调试原理和方法 10.2 FIFO IP的生成和调用
课程详情
本课程以数字逻辑基本理论和基本电路为基础,以美国Xilinx公司和美国Intel公司的软件和硬件为载体,系统讲授了基于现场可编程门阵列(field programmable gate array,FPGA)的复杂数字系统设计理论和设计方法。(北京化工大学)
本课程以数字逻辑基本理论和基本电路为基础,以美国Xilinx公司和美国Intel公司的软件和硬件为载体,系统讲授了基于现场可编程门阵列(field programmable gate array,FPGA)的复杂数字系统设计理论和设计方法。(北京化工大学)
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